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崗位職責(zé)： 1. 負(fù)責(zé)模擬電路模塊級(jí)別的版圖設(shè)計(jì)工作； 2. 根據(jù)電路設(shè)計(jì)工程師的需求，完成版圖設(shè)計(jì)，能夠主動(dòng)考慮版圖的布局布線，包括但不限于器件的匹配，大電流信號(hào)及電源走線，敏感信號(hào)走線的布局等； 3. 能夠理解并看懂不同F(xiàn)oundry的DRC/LVS規(guī)則文件； 4. 完成版圖物理層驗(yàn)證，包括DRC，LVS，ANTENNA，PEX和ERC等； 5. 負(fù)責(zé)完成 Review 以及優(yōu)化迭代，相關(guān)文檔的撰寫以及Tape-out前版圖檢查工作； 6. 對(duì)ESD，ERC，DFM，IR Drop，EM等知識(shí)有深刻理解，對(duì)CMOS工藝有深入了解。 基本任職條件： 1. 本科及以上學(xué)歷，微電子，電子科學(xué)與技術(shù)，電子工程等相關(guān)專業(yè)； 2. 具有2年以上模擬版圖經(jīng)驗(yàn)，有量產(chǎn)經(jīng)驗(yàn)者優(yōu)先； 3. 熟練掌握主流模擬版圖設(shè)計(jì)工具； 4. 具有團(tuán)隊(duì)合作精神，良好的溝通能力，有耐心，具備良好的口頭和書面表達(dá)能力； 5. 熟悉CMOS 40、28，22工藝模擬版圖者優(yōu)先。